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PIC18F6585/8585/6680/8680
DS30491C-page 144
2004 Microchip Technology Inc.
FIGURE 10-20:
RG4/P1D PIN BLOCK DIAGRAM
FIGURE 10-21:
RG5/MCLR/VPP PIN BLOCK DIAGRAM
Data Bus
WR LATG
WR TRISG
RD PORTG
Data Latch
TRIS Latch
RD TRISG
Schmitt
Trigger
Input
Buffer
I/O pin
Q
D
CK
Q
D
CK
EN
QD
EN
RD LATG
or
WR PORTG
1
0
CCP1 P1D Enable
P1D Out
Auto-Shutdown
Note: I/O pins have diode protection to VDD and VSS.
RG5/MCLR/VPP
Data Bus
RD PORTA
RD LATA
Schmitt
Trigger
MCLRE
RD TRISA
QD
EN
Latch
Filter
Low-Level
MCLR Detect
High-Voltage Detect
Internal MCLR
HV
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